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微信公众号：Spinal FPGA
互联网行业数据中心FPGA码农，记录FPGA进阶之路
听说你少一个绘图工具
#FPGA  #时序图 
今日给诸君推荐一个免费的绘图工具——Draw.io Integration
Spinal FPGA
“IP”库生成
#FPGA  #SpinalHDL 
基于IDEA生成jar包导出个人SpinalHDL IP设计。
Spinal FPGA
你想要的马車520直播回放链接在这里
#FPGA  #SpinalHDL 
马車昨晚关于Spinal520直播你看了么
Spinal FPGA
除了看波形，还能做点儿啥
#FPGA  #SpinalHDL 
要问做逻辑的什么看的最久，那一定是波形吧。那除了看波形，还能做点儿其他的么？
Spinal FPGA
再也不愁FSM难画了
#FPGA  #VSCode 
在Markdown中如何优雅的画FSM
Spinal FPGA
Markdown时序图绘制与表格绘制
#FPGA  #Markdown 
越来越觉得VSCode对Markdown的支持简直不要再完美。
Spinal FPGA
一键生成寄存器文档也容易
#FPGA  #SpinalHDL 
一键生成整个设计的寄存器文档
Spinal FPGA
若可以选,我宁愿重写曾经的“无聊”代码
#FPGA SpinalHDL 
今天，再来好好聊聊SpinalHDL中的FIFO。也许你是逻辑设计老手，但好好看看这篇文章，或许你也会有新的思考。
Spinal FPGA
从Verilog到SpinalHDL
#FPGA SpinalHDL 
该篇文章会不定期更新推送，用以同步公众号内所有和SpinalHDL文章归类汇总，多谢支持。
Spinal FPGA
你知道如何做多端口仲裁么
#FPGA SpinalHDL 
该小系列就SpinalHDL中关于StreamArbiter部分从基础原理到最终的实现细节进行总结。本篇先从roundRobin讲起。
Spinal FPGA
halfPipe是如何导致带宽减半的
#FPGA SpinalHDL 
Stream中的halfPipe方法为什么会导致带宽减半？
Spinal FPGA
推荐几个挺不错的功能
#FPGA SpinalHDL 
推荐几个SpinalHDL新版本引入的几个挺不错的API方法使用。
Spinal FPGA
FPGAer浅入浅出DDR——容量规格篇(一)
#FPGA  #DDR 
作为一个FPGA开发者，之前对于DDR的使用，一直仅限于对厂商接口的使用，像无论是Xilinx还是Intel，在使用DDR时甚至IP配置参数都不需要了解，直接从老的工程里把IP拷贝过来就可以，而在使用DDR时只需要会使用AXI4/AvalonMm标准总线接口就行了。混了这么多年，本着够用即可，再往下稍微了解些。个人总结，浅入浅出。让我设计一个控制器那可是难为我了。
Spinal FPGA
从Verilog到SpinalHDL
#前端  #spinal 
SpinalHDL和Chisel师承一脉，都是基于Scala来进行电路描述。其本质上仍旧是HDL而非HLS，在设计之前依旧需要有清晰的电路结构，只不过是在电路描述上更加方便和快捷而已。个人学习SpinalHDL已有半年时间，SpinalHDL在解决上面的那些痛点上觉得做的是相当优秀，有感兴趣的小伙伴不妨尝试了解下。诚然，SpinalHDL的入门曲线可能较陡一些，但越过此门当真是打开一个新的世界。结合SpinalHDL—Doc文档及个人学习经历，推出下面个人的SpinalHDL的笔记总结，建议结合SpinalHDL-Doc进行阅览。
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